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专利信息

基于VHDL的浮点数转ASCII码的方法及装置【异议或纠错】

档案编号： CQ-617-9193-9396
档案文号：
专利权人： 申请人 
发布时间： 发布时间 
档案分类： 专利权 
分 类 号： 第G06F7/575类
授权状态： 已授权
档案内容： 本发明提供了一种基于VHDL的浮点数转ASCII码的方法及装置,所述方法包括：接收浮点数据；按照浮点数据的位将所述浮点数据划分为符号位、指数部分和尾数部分；对所述符号位、指数部分和尾数部分处理,分别得到符号、整数和小数部分；对符号部分、整数部分和小数部分进行解析,根据解析结果对符号部分、整数部分和小数部分进行整合,得到ASCII码。充分利用FPGA并行计算的优势,分别对符号位、指数部分和尾数部分单独处理,提升了转换速度。同时,通过对符号位、指数部分和尾数部分的处理优化。将处理过程以简单的加减处理执行。充分利用VHDL语言的特点,可以实现快速准确的将浮点数转ASCII码。
附件下载：  (原始资料备查)

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